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[判断题]

二进制译码器每输入一组代码,只有与其对应的输出端信号无效,其他输出端信号都有效。()

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第1题
七段显示译码器,当译码器七个输出端状态为abcdefg=0110011时(高电平有效),输入二进制代码为()。

A.0100

B.0110

C.0011

D.0111

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第2题
编码器能将特定的输入信号变为二进制代码;而译码器能将二进制代码变为特定含义的输出信号,所以编码器与译码器使用是可逆的。()
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第3题
在二进制译码器中,如果输入代码有n位,则有2的(n-1)次方个输出信号。()
在二进制译码器中,如果输入代码有n位,则有2的(n-1)次方个输出信号。()

A.错误

B.正确

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第4题
输入为n位二进制代码的译码器输出端个数为()

A、n2个

B、2n个

C、2n个

D、n个

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第5题
实现将输入信号编成一个对应的二进制代码逻辑功能的是______。
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第6题
某个器件具有多个输入端和多个输出端,当输入端加上某一组合信号时,对应这一组合信号的若干个输出端便有信号输出,这种把输入的一种格式的代码信号变成另一种格式的信号,以实现代码所要求的操作的器件是______。

A.计数器

B.译码器

C.寄存器

D.数据选择器

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第7题
()的功能是将一种码制的代码转换成另一种码制的代码。

A.二进制译码器

B.十进制译码器

C.码制变换译码器

D.显示译码器

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第8题
设X(i)为串行同步输入序列,每时钟elk的上升沿时输入1个数据,每个X(i)数据是1位二进制数。检测电路将每连续5

设X(i)为串行同步输入序列,每时钟elk的上升沿时输入1个数据,每个X(i)数据是1位二进制数。检测电路将每连续5个X(i)数据分为一组,当其中有3个及3个以上的‘1’时,在第五个数据输入的clk周期内输出‘1’,否则输出‘0’。试用VHDL实现此检测电路。画出状态图。

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第9题
二进制差分译码器输入端系统误码率为Pe,则在差分译码器的输出端系统误码率为______。

二进制差分译码器输入端系统误码率为Pe,则在差分译码器的输出端系统误码率为______。

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第10题
3/8线译码器的输入信号是十六进制代码。()
3/8线译码器的输入信号是十六进制代码。()

A.正确

B.错误

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第11题
输出低电平有效的二—十进制译码器输出Y5’=0时它的输入代码为()

A.0101

B.0011

C.1001

D.0111

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