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第4题
图10.18为一个左移位寄存器，在下侧加一个组合逻辑电路（与非门G1，G2，G3和G4)。数码由D端经组合逻辑电路送至最
图10.18为一个左移位寄存器，在下侧加一个组合逻辑电路(与非门G1，G2，G3和G4)。数码由D端经组合逻辑电路送至最低位触发器输入端 D0。X为控制端。试分析当X＝0和X＝1时，电路的逻辑功能。
第8题
试用与非门设计实现函数F（A，B，C，D)=∑m（2，6，10，13，14，15)的组合逻辑电路。
试用与非门设计实现函数F(A，B，C，D)=∑m(2，6，10，13，14，15)的组合逻辑电路。
第11题
据称图2—19所示电路是按表2—22真值表设计的译码器，输入端不会出现的两种代码010和101未在真值表
中列出，请检查一下： ①电路能否满足真值表所规定的要求？若不能，指出错在何处。 ②该电路在用与非门实现的条件下是最简的吗？若不是，请画出用与非门实现的最简电路。
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