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[主观题]

图中所示ADC中,已知4位DAC输出满量程电压Vomax=15V,触发器现态为0,计数器响应下降沿,输入电压V1=10V,试求:

图中所示ADC中,已知4位DAC输出满量程电压Vomax=15V,触发器现态为0,计数器响应下降沿,输入电压V1=10V,试求:

图中所示ADC中,已知4位DAC输出满量程电压Vomax=15V,触发器现态为0,计数器响应下降沿,

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第1题
图中所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135(位双积分型),DAC为DAC1210(12位MDAC)。在不

图中所示是一个简易的电压采集和反馈控制系统,其中ADC为ICL7135(位双积分型),DAC为DAC1210(12位MDAC)。在不考虑数据处理的情况下,试设计控制ADC采集输入数据,并直接由DAC输出反馈控制电压Vo的控制器流程,给出时序图和电路图。

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第2题
图中所示为一种集成串/并行型ADC,请分析该框图,回答下列问题: (1)串行级数; (2)计算输出位数公式。

图中所示为一种集成串/并行型ADC,请分析该框图,回答下列问题:

(1)串行级数;

(2)计算输出位数公式。

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第3题
采用单极性电流相加六位R~2R T型电阻网络DAC构成的双极性DAC,如图6-13所示,图中VROF=-VREF,求:

采用单极性电流相加六位R~2R T型电阻网络DAC构成的双极性DAC,如图6-13所示,图中VROF=-VREF,求: (1)偏流补偿电阻ROF的值; (2)当输入D’=000000时,输出Vo’为多少? (3)当D″=100000时,VO″为多少?

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第4题
在逐次渐近型ADC中,为了减小量化误差,在转换器的DAC的输出电路中增加LSB偏置电路,图L11-10(a)即为其中的一

在逐次渐近型ADC中,为了减小量化误差,在转换器的DAC的输出电路中增加LSB偏置电路,图L11-10(a)即为其中的一种,试分析该偏置电路的工作原理。其中,DAC为10位倒T形D/A转换器。

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第5题
设CPLD中某宏单元编程后电路如下图所示,图中画出了S1~S8和M1、M3编程后的连接。数据分配器S1~S8未被选中的输

设CPLD中某宏单元编程后电路如下图所示,图中画出了S1~S8和M1、M3编程后的连接。数据分配器S1~S8未被选中的输出为0。已知各乘积项如下图中所示。

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第6题
在10位逐次渐近型A/D转换器中,其DAC的输出电压波形与输入电压vI如图L11-9(b)所示。

在10位逐次渐近型A/D转换器中,其DAC的输出电压波形与输入电压vI如图L11-9(b)所示。

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第7题
已知网络如图7.3所示,取图中电压u2和电流i2作为输出,试建立该网络的状态方程和输出方程。

已知网络如图7.3所示,取图中电压u2和电流i2作为输出,试建立该网络的状态方程和输出方程。

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第8题
某DAC电路如下图所示,图中当Qi=1时,相应的模拟开关Si打在1的位置;当Q一0时,相应的模拟开关S;打在0的位置。

某DAC电路如下图所示,图中当Qi=1时,相应的模拟开关Si打在1的位置;当Q一0时,相应的模拟开关S;打在0的位置。

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第9题
图题8.4所示D/A转换器,分析该DAC电路,试确定输出最大幅度为UREF,反馈电阻RF的数值。

图题8.4所示D/A转换器,分析该DAC电路,试确定输出最大幅度为UREF,反馈电阻RF的数值。

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第10题
在设计中,DSP可以通过()与ADC/DAC相连。

A.并行总线

B.串口

C.预处理系统

D.并行总线或者串口

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第11题
在如下图所示3位加权型DAC电路,设VREF=-8V,2RF=R,VB=-VREF。 <W> 说明VB和RB电路的作用 <W>

在如下图所示3位加权型DAC电路,设VREF=-8V,2RF=R,VB=-VREF

<W> 说明VB和RB电路的作用

<W> 求输出电压表达式

<W> 要求当D=100时,要使输出Vo=0,求RB

<W> 求D=000和D=111时的输出电压

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