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[主观题]
输入信号A的波形和CP的波形如图5-47所示,试画出该电路中触发器输出Q的波形(初始状态为0)。
输入信号A的波形和CP的波形如图5-47所示,试画出该电路中触发器输出Q的波形(初始状态为0)。
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输入信号A的波形和CP的波形如图5-47所示,试画出该电路中触发器输出Q的波形(初始状态为0)。
JK触发器组成如图4.2.5所示的电路,其中为置位端,为清零端。试分析电路功能,将信号、D、CP、A和Qn+1的关系列成功能表的形式。若_已知、D、CP、A的波形如图4.2.5(b)所示,试画出Q端波形。
图(a)是用TTL主从JK触发器构成的信号检测电路,用来检测CP高电平期间“是否有输入脉冲,若CP,u的波形如图(b)所示,画出输出Q的波形。
CMOS电路如图2.2.10(a)所示,已知输入A、B及控制信号C的波形如图2.2.10(b)所示,试画出Q的波形。
电路如图3.3(a)所示,输入信号波形如图3.3(b)所示,已知输入信号加入前电路处于稳态(零状态),试求iL(t)的表达式,并画出其波形。
图6-15中输入时钟信号CP的周期TCP=1kHz,试画出DAC输出电压Vo的时间波形图(画两个波形重复周期)。设计数器初态为000。
2选1多路选择器如图9.22(a)所示,信号输入为A,B,选择控制为S。已知A,B和S的波形如图9.22(b)所示,试画出F的波形。
已知状态表如图4-49(a)所示,若电路的初态Q2Q1=00,输入信号波形如图4-49(b)所示,试画出Q1、Q2的波形(设触发器响应于负跳变)。