设计以下3变量组合逻辑电路: (1)判奇电路。输入中有奇数个1时,输出为1,否则为0。 (2)判偶电路。输入中有偶数
设计以下3变量组合逻辑电路:
(1)判奇电路。输入中有奇数个1时,输出为1,否则为0。
(2)判偶电路。输入中有偶数个1时,输出为1,否则为0。
(3)判一致电路。输入变量取值相同时,输出为1,否则为0。
(4)判不一致电路。输入变量取值不一致时,输出为1,否则为0。
(5)被3整除电路。输入能被3整除时,输出为1,否则为0。
(6)A,B,C多数表决电路。有2个或2个以上为1时输出才为1,但C有否决权。
列真值表,如表A.2-13所示。为方便起见,表中同时给出了6个输出变量的真值表。
表 A.2-13 真值表
|