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第1题
图12.19所示是一个排队电路，对它的要求是：当某个输入单独为1时，与该输入对应的输出亦为1。若是有2个或3个输
入为1时，则只能按A、B、C的排队次序，排在前面的这一对应的输出为1，其余只能为0。试分析该电路是否能满足这一要求。
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第2题
用一片如图A1－5所示的GAL16V8设计实现带有控制端的一位全加器，假设一位全加器的数据输入为Ai和Bi，低位进位
用一片如图A1-5所示的GAL16V8设计实现带有控制端的一位全加器，假设一位全加器的数据输入为Ai和Bi，低位进位为Ci，数据输出为Si(和)和Ci+1(高位进位)。
第3题
差分放大电路的差模信号是两个输入端信号的差，共模信号是两个输入端信号的( )。
差分放大电路的差模信号是两个输入端信号的差，共模信号是两个输入端信号的（)。
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差分放大电路的差模信号是两个输入端信号的差，共模信号是两个输入端信号的()。
A、平均值
B、差
C、和
第4题
反相比例运算电路中集成运放反相输入端为虚地，而同相比例运算电路中集成运放两个输入端的电位等于输入电压。()
反相比例运算电路中集成运放反相输入端为虚地，而同相比例运算电路中集成运放两个输入端的电位等于输入电压。（)
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A.错误
B.正确
第7题
下图所示的两个点画线框中分别为共射组态（单元电路Ⅰ)和共集组态（单元电路Ⅱ)。如果输入端、输出端和级间均采用
下图所示的两个点画线框中分别为共射组态(单元电路Ⅰ)和共集组态(单元电路Ⅱ)。如果输入端、输出端和级间均采用电容耦合，并以下列方式组成多级放大电路；①Ⅰ(去掉RL)+Ⅰ，②Ⅰ(去掉RL)+Ⅱ+Ⅰ，③Ⅱ+Ⅰ(去掉RL)+Ⅱ，试分析：
第8题
画出实现n位小数（不包括符号位在内)的补码一位乘运算器框图。要求： （1)指出寄存器和全加器位
画出实现n位小数(不包括符号位在内)的补码一位乘运算器框图。要求： (1)指出寄存器和全加器位数； (2)详细画出最低位全加器的输入电路； (3)描述重复加和移位的操作； (4)指出加和移位次数。
第10题
设到达接收机输入端的两个等可能的确知信号为s1（t)和s2（t)，它们的持续时间为（0，T)，且有相同能量，相应的先验
设到达接收机输入端的两个等可能的确知信号为s1(t)和s2(t)，它们的持续时间为(0，T)，且有相同能量，相应的先验概率为P(s1)和P(s2)。接收机输入端的噪声n(t)是高斯白噪声，且其均值为0，单边功率谱密度为n0。试按照似然比准则设计一最佳接收机。(注：要求有推导过程，并画出最佳接收机结构，有关参数要自行假设)
第11题
设有一个16位定点补码运算器，序号n为最低位，能实现下述功能： A±X→A X×Q→A／／Q（高位积在
设有一个16位定点补码运算器，序号n为最低位，能实现下述功能： A±X→A X×Q→A／／Q(高位积在A中) A÷X→Q(商在Q中) (1)列出实现上述功能的控制信号； (2)画出全加器第5位和A、Q寄存器第5位的输入电路。
