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[主观题]

一个二进制十位逐次比较型ADC，试列出输入模拟电压为968个量化单位时的逐次比较表格，并画出反馈电

压VF的工作波形图。

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第1题

A/D转换器中，转换时间最短的是（)。

A.并行比较型ADC

B.逐次比较型ADC

C.双积分型ADC

D.并行比较型ADC和双积分型ADC

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第2题

逐次逼近型ADC电路由（)组成。

A.移位寄存器

B.D/A转换器

C.参考电压源VREF

D.电压比较器

E.脉冲发生器及控制电路

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第3题

某计数型ADC的原理图如图所示，其中C为电压比较器，当vI＞v'o时，vC=1，否则vC=0，试分析其工作原理。

某计数型ADC的原理图如图所示，其中C为电压比较器，当v_I＞v'_o时，v_C=1，否则v_C=0，试分析其工作原理。

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第4题

一个N位逐次逼近型A/D转换器完成一次转换要进行N次比较，需要N+2个时钟脉冲。()

一个N位逐次逼近型A/D转换器完成一次转换要进行N次比较，需要N+2个时钟脉冲。（)

A.正确

B.错误

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第5题

上题给的电路实现了V－F的转换，若要构成一个完整的V－F型ADC，还需要增加哪些电路，以便把电路输出与

上题给的电路实现了V-F的转换，若要构成一个完整的V-F型ADC，还需要增加哪些电路，以便把电路输出与输入电压成正比的脉冲串转变为二进制码或BCD码，即转变为相应的数字量？试自行配置电路。

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第6题

如图所示电路可用作阶梯波发生器。如果计数器是加／减计数器，它和DAC相适应，均是十位（二进制数)，时钟频率为1M

如图所示电路可用作阶梯波发生器。如果计数器是加/减计数器，它和DAC相适应，均是十位(二进制数)，时钟频率为1MHz，求阶梯波的重复周期，试画出加法计数和减法计数时DAC的输出波形(控制信号S=0，加计数；S=1，减计数)。

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第7题

用于数字仪表的ADC较多采用()。

用于数字仪表的ADC较多采用（)。

A、并行比较型ADC

B、逐步比较型ADC

C、双积分型ADC

D、串并比较型ADC

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第8题

用于视频信号处理的A/D转换单片集成电路大多采用()ADC。

A.单积分型

B.双积分型

C.并行比较型

D.串并比较型

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第9题

AD574是一个完整的12位逐次逼近型带三态缓冲器的A/D转换器( )。

AD574是一个完整的12位逐次逼近型带三态缓冲器的A/D转换器（)。

AD574是一个完整的12位逐次逼近型带三态缓冲器的A/D转换器()。

A、错误

B、正确

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第10题

欲对十个信息以二进制代码编码分别表示每个信息，最少需十位二进制代码。()

欲对十个信息以二进制代码编码分别表示每个信息，最少需十位二进制代码。（)

A.错误

B.正确

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第11题

一个八位的逐次副近型A/D转换器，允许输入电压U₁满足0≤UI＜/sub＞]＜10V，若U_I＝6V，当时钟频率f＝100kHz时，转换时间为( )。

A.100μs

B.80μs

C.60μs

D.40μs

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