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[主观题]

设机器数字长为n位(不包括符号位),画出原码两位乘的运算器框图(图中必须反映原码两位乘算法),要

设机器数字长为n位(不包括符号位),画出原码两位乘的运算器框图(图中必须反映原码两位乘算法),要求: (1)寄存器和全加器均用方框表示; (2)指出每个寄存器的位数及寄存器中操作数的名称; (3)详细画出第5位全加器的输入逻辑电路(设第n位为最末位); (4)描述原码两位乘法过程中的重复加和移位操作。

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第1题
设机器数字长为n位(不包括符号位),画出补码加减交替法的运算器框图(图中必须反映补码加减法算法)

设机器数字长为n位(不包括符号位),画出补码加减交替法的运算器框图(图中必须反映补码加减法算法),要求: (1)寄存器和全加器均用方框表示; (2)指出每个寄存器的位数及寄存器中操作数的名称; (3)详细画出第5位全加器的输入逻辑电路(设第n位为最末位); (4)描述补码加减交替操作和上商操作。

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第2题
设机器数字长为n位(不包括符号位),画出补码一位乘的运算器框图(图中必须反映补码一位乘算法),要

设机器数字长为n位(不包括符号位),画出补码一位乘的运算器框图(图中必须反映补码一位乘算法),要求: (1)寄存器和全加器均用方框表示; (2)指出每个寄存器的位数及寄存器中操作数的名称; (3)详细画出第5位全加器的输入逻辑电路; (4)描述补码一位乘法过程中的重复加和移位操作。

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第3题
设机器数字长为n位(不包括符号位),画出原码一位乘的运算器框图(图中必须反映原码一位乘算法),要

设机器数字长为n位(不包括符号位),画出原码一位乘的运算器框图(图中必须反映原码一位乘算法),要求: (1)寄存器和全加器均用方框表示; (2)指出每个寄存器的位数及寄存器中操作数的名称; (3)详细画出第5位全加器的输入逻辑电路(设第n位为最低位); (4)描述原码一位乘法过程中的重复加和移位操作。

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第4题
假设机器数字长为32位(不包括符号位),若一次加法需1μs,一次移位需lμs,则完成原码1位乘法、原码2位

假设机器数字长为32位(不包括符号位),若一次加法需1μs,一次移位需lμs,则完成原码1位乘法、原码2位乘法、补码加减交替除法(设上商和移位同时进行)所需的时间分别为______、_______、__________、_____________。

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第5题
设机器数字长为8位(含1位符号位),设A= 一19/32,B=一17/128,计算[A±B]补,并还原成真值。

设机器数字长为8位(含1位符号位),设A= 一19/32,B=一17/128,计算[A±B]补,并还原成真值。

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第6题
在补码1位乘法中,设[x]补为被乘数,[y]补为乘数。若ynyn+1(yn+1为低位)=00,应执行_______操作;若yn

在补码1位乘法中,设[x]补为被乘数,[y]补为乘数。若ynyn+1(yn+1为低位)=00,应执行_______操作;若ynyn+1=01,应执行_______操作;若ynyn+1=10,应执行___________操作;若ynyn+1=11,应执行____________操作。总机器数字长为16位(不包括符号位),则补码乘法需作___________次____________操作,最多需作__________次_________操作。

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第7题
设操作数字长16位(不包括符号位),机器做原码两位乘运算,共需做________次________操作,最多需做_

设操作数字长16位(不包括符号位),机器做原码两位乘运算,共需做________次________操作,最多需做________次________操作,才能得到最后乘积,乘积的符号位需________。

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第8题
设操作数字长15位(不包括符号位),机器作原码两位乘运算,共需做________次________操作,最多需做_

设操作数字长15位(不包括符号位),机器作原码两位乘运算,共需做________次________操作,最多需做________次________操作,才能得到最后乘积,乘积的符号位需________。

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第9题
设操作数字长16位(不包括符号位),机器作原码两位乘运算,共需作__________次操作,最多需做_______

设操作数字长16位(不包括符号位),机器作原码两位乘运算,共需作__________次操作,最多需做_________次____________操作,才能得到最后的乘积,乘积的符号位需______________。

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第10题
画出并行补码定点加减运算器框图(设机器数采用2位符号位),并描述其信息加工过程。

画出并行补码定点加减运算器框图(设机器数采用2位符号位),并描述其信息加工过程。

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第11题
画出并行补码定点加减运算器框图(设机器数采用1位符号位),并描述其信息加工过程。

画出并行补码定点加减运算器框图(设机器数采用1位符号位),并描述其信息加工过程。

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